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2024.10.26 01:36

ブロックデザインのシミュレーション


・うまくいかない。ブロックデザインでVerilogなブロックを作る。これは問題なくいけたし、ちゃんと動いた。しかし、それをシミュレーションするのがうまくいかない。
・とりあえず、Verilogのみでやっていたときと同様にSimulation Sourceを追加する。これは問題ない。そして、ここからシミュレーションしたいわけだ。となるとVerilogで書かれたWrapperをテストベンチの中でインスタンス化して利用すれば良いのだろう。
・ということでやってみると見事に落ちてVivadoの画面が消えてしまう。何度やっても落ちる。何をやっても落ちる。
・ふと気がつけばホームディレクトリの下になにやら残骸のようなファイルが積もり積もっている。さて、どうしたら良いのだろう。